寄存器描述
8 Apr 2024
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0x000 LVDS_CTL
默认值:0x00000000 | LVDS 控制(LVDS Control) | ||
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位域 | 类型 | 默认值 | 描述 |
31:10 | - | - | - |
9:8 | R/W | 0x0 | LVDS_MODE LVDS 模式
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7:2 | - | - | - |
1 | R/W | 0x0 | LVDS_SYNC_MODE_EN LVDS 同步前端信号模式
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0 | R/W | 0x0 | LVDS_EN LVDS 模块使能控制
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0x010 LVDS_CK_CFG
默认值:0x00000063 | LVDS 时钟配置(LVDS Clock Configuration) | ||
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位域 | 类型 | 默认值 | 描述 |
31:7 | - | - | - |
6:0 | R/W | 0x63 | CLK_WAVE 时钟波形寄存器协议规定采用 7b'1100011 |
0x020 LVDS_SWAP
默认值:0x00043210 | LVDS 通道交换(LVDS Swap) | ||
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位域 | 类型 | 默认值 | 描述 |
31:19 | - | - | - |
18:16 | R/W | 0x4 | LVDS_D3_SEL LVDS_D3 通道输出选择
主要用于解决产品应用电路中输入输出 LVDS 信号交叉,可通过软件控制切换通道避免 layout 绕线。 |
15 | - | - | - |
14:12 | R/W | 0x3 | LVDS_CK_SEL LVDS_CK 通道输出选择
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11 | - | - | - |
10:8 | R/W | 0x2 | LVDS_D2_SEL LVDS_D2 通道输出选择
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7 | - | - | - |
6:4 | R/W | 0x1 | LVDS_D1_SEL LVDS_D1 通道输出选择
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3 | - | - | - |
2:0 | R/W | 0x0 | LVDS_D0_SEL LVDS_D0 通道输出选择
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0x028 LVDS_POL_CTL
默认值:0x00000000 | LVDS 通道 0 极性控制(LVDS 0 Polarity Control) | ||
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位域 | 类型 | 默认值 | 描述 |
31:5 | - | - | - |
4 | R/W | 0x0 | LVDS_D3_POL LVDS_D3 信号极性反相控制
当极性反相时,差分对信号正负极性互换。主要用于解决产品应用电路中输入输出 LVDS
正负信号接线交叉,可通过软件控制切换模式避免 layout 绕线 注: 此信号对应 SEL 通道。若更换,则同时更换,例如 SEL 选择输出 D0,则此位控制 D0
相位 |
3 | R/W | 0x0 | LVDS_CK_POL LVDS_CK 信号极性反相控制
注: 此信号对应 LVDS_CK_SEL 通道。
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2 | R/W | 0x0 | LVDS_D2_POL
注: 此信号对应 LVDS_D2_SEL 通道。
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1 | R/W | 0x0 | LVDS_D1_POL LVDS_D1 信号极性反相控制
注: 此信号对应 SEL 通道。
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0 | R/W | 0x0 | LVDS_D0_POL LVDS_D0 信号极性反相控制
注: 此信号对应 SEL 通道。
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0x030 _PHY_CTL
默认值:0x0000003A | LVDS 通道 0 物理层控制(LVDS 0 Physical Layer Control) | ||
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位域 | 类型 | 默认值 | 描述 |
31:10 | - | - | - |
9 | R/W | 0x0 | LDO 参考电压调节(reg_pwslv) |
8 | R/W | 0x0 | Mbias 参考电压调节(reg_pwsmb) |
7 | R/W | 0x0 | 参考电压/电流使能控制(en_mb)
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6 | R/W | 0x0 | LVDS LDO 使能控制(en_ldo)
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5:4 | R/W | 0x3 | LVDS 共模电压选择(reg_v<1:0>)
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3:2 | R/W | 0x2 | LVDS 输出波形斜率调节控制(reg_pd<1:0>)
通常使用默认值 |
1:0 | R/W | 0x2 | LVDS 差模电压调节选择(reg_c<1:0>)
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0x0FC VERSION
默认值: | 版本号(Version) | ||
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位域 | 类型 | 默认值 | 描述 |
31:0 | RO | Version 模块版本号,采用 BCD 码显示, |