时钟配置
3 Mar 2025
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BROM 阶段使用的总线和模块，以及各模块的时钟配置如下表所示。
名字 |
量产工作频率(MHz) |
量产时钟来源 |
时钟源频率(MHz) |
时钟除频 |
|---|---|---|---|---|
AXI |
24 |
OSC24M |
24 |
– |
AHB |
60 |
PLL_INT1 |
1200 |
20 |
APB0 |
24 |
OSC24M |
24 |
– |
APB1 |
24 |
OSC24M |
24 |
– |
CPU |
24 |
OSC24M |
24 |
– |
SRAM |
60 |
PLL_INT1 |
1200 |
20 |
SID |
24 |
OSC24M |
24 |
– |
UART |
24 |
OSC24M(APB1) |
24 |
– |
TIMER |
24 |
OSC24M(APB1) |
24 |
– |
DMA |
60 |
PLL_INT1(AHB) |
1200 |
20 |
SDMC |
24 |
PLL_FRA0 |
1008 |
21 |
SPI |
24 |
PLL_FRA0 |
1008 |
21 |
SPIENC |
60 |
PLL_INT1(AHB) |
1200 |
20 |
CE |
200 |
PLL_INT1 |
1200 |
6 |
USB |
60 |
PLL_INT1(AHB) |
1200 |
20 |
说明：
-
SDMC/SPI 模块输入的频率为 48MHz，内部二分频，因此最大工作频率为 24 MHz。
-
USB/ DMA/ SPIENC/ SRAM/ ROM 直接使用 AHB 的时钟频率。